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  • …a instrucciones), 96 KB de caché de segundo nivel integrada en el núcleo y 2 ó 4 MB de caché de tercer nivel exterior al núcleo. Estaba disponible en ve …argo, esas máquinas eran útiles para desarrollar software para los Itanium 2. [[IBM]] creó un supercomputador basado en este procesador.<ref name="Thund …
    5 kB (637 palabras) - 17:29 30 ago 2021
  • …enen una [[Arquitectura de computadores|arquitectura]] [[Multi núcleo|dual-core]] que consiste en un núcleo de procesador de propósito general [[ARM]] y un ===OMAP 2=== …
    3 kB (401 palabras) - 04:47 17 oct 2021
  • | microarch = P6, NetBurst, Intel Core …Pentium 4]] e [[Intel Core 2 Duo]]. El más reciente esta basado en el Core 2 Duo (Allendale). …
    16 kB (2570 palabras) - 17:28 30 ago 2021
  • *'''[[CPU]]''': [[AMD Athlon 64 X2]] 3800+ Dual-Core o [[AMD Athlon 64]] o [[AMD Sempron]] * [[RAM]] : hasta 2 GB de memoria [[DDR2 SDRAM]] 533/667 MHz en dos [[SO-DIMM]] con soporte de …
    6 kB (876 palabras) - 21:34 20 ago 2021
  • …ños típicos de la memoria caché L2 oscilan en la actualidad entre 256 kb y 2 Mb. En los procesadores habituales el chipset está formado por 2 circuitos auxiliares al procesador principal: …
    12 kB (1710 palabras) - 18:21 30 ago 2021
  • …e de los conectores Molex de 24 pines (20+4) (fuente alimentación ATX&nbsp;2.x)<ref>{{Cita web ** [[Intel Pentium D]] 8xx hasta el D820, 2 x 1 [[Megabyte]] de memoria Caché L2, [[front-side bus]] a 800 MHz …
    4 kB (539 palabras) - 10:35 30 ago 2021
  • …K5]] (PR75 - PR200)<br />IDT [[WinChip]] (180 - 200 MHz)<br />IDT WinChip-2 (200 - 240 MHz)<br />IDT WinChip-2a (233 MHz)<br /> y compatibles …ita=Socket 5 has been defined for the Pentium processor-based systems with core frequencies from 75 MHz to 120 MHz. }}</ref><ref> …
    4 kB (569 palabras) - 18:02 16 oct 2021
  • …Image], [http://www.apple.com/es/macosx/features/coreaudio/ Core Audio], [[Core Video]], [http://www.apple.com/es/macosx/features/opengl/ OpenGL] y [http:/ …podada [[Mac OS X v10.1|Puma]]. La versión 10.2 fue llamada [[Mac OS X v10.2|Jaguar]] publicitariamente, y de esta versión en adelante se han seguido ha …
    18 kB (2975 palabras) - 18:07 30 ago 2021
  • …: [[Intel Core 2 Duo]] T7100 (1,8 [[GHz]], 800 MHz, 2MB L2 cache) o T7300 (2.0 GHz, 800 MHz, 4MB L2 cache) *'''[[RAM]]''' : de 512 [[MB]] a 2 [[GB]] [[DDR2]] a 667 MHz en dos [[SO-DIMM]]. Sin memoria en la [[placa mad …
    4 kB (535 palabras) - 10:35 30 ago 2021
  • | frecuencia = 1,2 [[GHz]] (quad-core) 2×[[USB]] 2.0, soportando hasta 1,5[[Amperio|A]]<br /> …
    5 kB (684 palabras) - 19:19 30 ago 2021
  • …soporta hasta el [[Intel Pentium 4]] HT con FSB a 1066 [[MHz]] FSB y hasta 2 [[GiB]] [[DDR2 SDRAM]]. Versiones posteriores amplian el soporte a los procesadores Dual Core
    5 kB (711 palabras) - 20:25 18 sep 2021
  • [[Archivo:Imac core duo.jpg|thumb|300px|Apple [[iMac]] Intel Core Duo de 20 pulgadas]] * [[Kaypro "New" 2]] …
    8 kB (1138 palabras) - 23:06 29 ago 2021
  • |número de núcleos=1, 2, 4, 6, 8, 12 y 16 [[Archivo:Quad-Core AMD Opteron processor.jpg|miniaturadeimagen|derecha|Opteron "Barcelona" de …
    41 kB (6056 palabras) - 00:50 23 oct 2021
  • * [[Aakash 2.0]] ** [[bq Curie 2]] …
    18 kB (2853 palabras) - 18:37 22 ago 2021
  • …TG Daily | fechaacceso=14-8-2007}}</ref> siendo sustituido por los [[Intel Core Duo]] …notablemente superiores a los Pentium III. En agosto, los modelos de 1,9 y 2,0 GHz vieron la luz (todavía con la inicial [[fundición (electrónica)|tecno …
    16 kB (2545 palabras) - 17:29 30 ago 2021
  • *'''[[CPU]]''': [[AMD K6-2]] a 475 [[MHz]] !2
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  • *'''[[CPU]]''': [[AMD K6-2]] a 475 [[MHz]] !2
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  • …la implementación de EDGE por parte de un operador, la red principal, o [[core network]], no necesita ser modificada, sin embargo, las estaciones bases,… La definición de EDGE, si es de 2 o 3G, depende de su implementación. Mientras la Clase 3 e inferiores, clara …
    4 kB (734 palabras) - 09:50 30 ago 2021
  • …s de los ocho registros existentes de la coma flotante, pueden representar 2 números de 32 bits, cuatrop de 16 u 8 de 8 bits. Durante el diseño original …28 bits y recientemente con [[SSSE3]], introducido con la [[Intel P8|Intel Core Microarchitecture]]. Soportar cualquiera de estos sets implica soportar MMX …
    4 kB (778 palabras) - 18:38 30 ago 2021
  • …oría de los protocolos que trabajan en la [[Nivel_de_enlace_de_datos |capa 2 del modelo OSI]] usan una de las tres numeraciones manejadas por el [[IEEE] MAC opera en la [[Nivel_de_enlace_de_datos |capa 2 del modelo OSI]], encargada de hacer fluir la información libre de errores …
    5 kB (845 palabras) - 09:04 30 ago 2021
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